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#_registers_scope OrigenARM::Cores::CortexM::Base
#core_reg_to_dcrdr OrigenARM::Cores::CortexM::BaseController
#enter_debug_mode OrigenARM::Cores::CortexM::CM33Controller
#enter_debug_mode_delay! OrigenARM::Cores::CortexM::BaseController
#enter_debug_mode_delay_cycles OrigenARM::Cores::CortexM::Base
#exit_debug_mode OrigenARM::Cores::CortexM::CM33Controller
#exit_debug_mode_delay! OrigenARM::Cores::CortexM::BaseController
#exit_debug_mode_delay_cycles OrigenARM::Cores::CortexM::Base
#in_debug_mode OrigenARM::Cores::CortexM::BaseController
#initialize OrigenARM::Cores::CortexM::Base
#initialize OrigenARM::Cores::CortexM::CM33
#initialize OrigenARM::Cores::Base
#initialize OrigenARM::Cores::BaseController
#initialize OrigenARM::Cores::CortexM::CM33Controller
#initialize OrigenARM::Cores::CortexM::BaseController
#initialize_core OrigenARM::Cores::CortexM::CM33Controller
instantiate_core_registers OrigenARM::Cores::CortexM::Base::Registers
instantiate_registers OrigenARM::Cores::CortexM::Base::Registers
#instantiate_registers OrigenARM::Cores::CortexM::CM33::Registers
#read_debug_register_delay OrigenARM::Cores::CortexM::Base
#read_register OrigenARM::Cores::CortexM::BaseController
#reg_wrapped_by_dcrsr? OrigenARM::Cores::CortexM::BaseController
#set_pc OrigenARM::Cores::CortexM::CM33Controller
#set_sp OrigenARM::Cores::CortexM::CM33Controller
#write_debug_register_delay OrigenARM::Cores::CortexM::Base
#write_register OrigenARM::Cores::CortexM::BaseController